评估高性能 ADC 需要一个低抖动时钟
噪声时钟源 (例如：刚刚检查的时钟源) 上的抖动可以减低吗? 采用先前的时钟源，在时钟的输出和演示板的时钟输入之间插入一个 TTE 低通滤波器1。测得的时钟抖动减小至 54.7psRMS (如图 5 所示)，而最终的 SNR 则改善至 96.8dBFS (如图 6 给出的 PScope 截屏所示)。虽然取得了小幅改善，但其仍然不如基线 SNR 测量结果那么好。接着，插入一个 TTE 带通滤波器2以替代低通滤波器。现在，测得的时钟抖动为 16.7psRMS (如图 7 所示)，而 SNR 的测量结果则显著地改善至 98.3dBFS (如图 8 给出的 PScope 截屏所示)。测得的 SNR 此时与基线 SNR 测量值相同。
图 5：噪声时钟源的低通滤波降低了 CNV 输入端上的抖动
图 6：噪声时钟源的低通滤波轻微改善了 SNR
图 7：TTE 带通滤波器极大地降低了抖动
图 8：TTE 带通滤波器显著地改善了 LTC2389-18 的 SNR 指标
现在可以很容易的了解在评估高分辨率 ADC 时采用低抖动时钟源的必要性。如果您现有可用的时钟源不具备足够低的抖动，那么通过利用一个优良的带通滤波器对时钟实施滤波仍然能够获得上佳的 SNR 测量结果。
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