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多个AD9779TxDAC器件的同步
简介 AD9779 TxDAC的DAC输出采样速率最高可达1 GSPS.在某些应用中，例如需要波束导引的应用，用户可以同步多个AD9779.因此，当AD9779以接近最高速度工作时，TxDAC时序特性变得至关重要。 本应用笔记不
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DS18B20数字温度计实验步骤
DS18B20数字温度计是DALLAS公司生产的1－Wire，即单总线器件，具有线路简单，体积小的特点。因此用它来组成一个测温系统，具有线路简单，在一根通信线，可以挂很多这样的数字温度计，十分方便。1．DS18B20产品的特点
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零电流关断(ZCS)PWM DC/DC变换器电路图及时序分析
零电流关断(ZCS)PWM DC/DC变换器电路图拓扑结构：Buck DC/DC ZCS PWM变换器。主开关T1（包含反并联二极管D1），辅助二极管T2（D2是T2的反并联二极管）。假设：二极管开关管均为理想器件；电感、电容均为理想元件；Cr
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DS18B20数字温度计设计
1．DS18B20基本知识DS18B20数字温度计是DALLAS公司生产的1－Wire，即单总线器件，具有线路简单，体积小的特点。因此用它来组成一个测温系统，具有线路简单，在一根通信线，可以挂很多这样的数字温度计，十分方便。2、
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密码报警控制电路介绍
在一些重要部门或仓库常设有报警装置，以防外人非法进入。图4-6-3(a)所示为某报警装置的系统框图。图4-6-3 密码报警系统图4-6-3(b)为密码控制电路的原理图。 该密码控制单元输入、输出信号较多，不易用状态图（表
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信号完整性的电路板设计准则
信号完整性(SI)问题解决得越早，设计的效率就越高，从而可避免在电路板设计完成之后才增加端接器件。SI设计规划的... 信号完整性(SI)问题解决得越早，设计的效率就越高，从而可避免在电路板设计
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日本新技术利用螃蟹壳制造显示器面板
蟹是人们很喜欢的一种食物，每年的大闸蟹也是屡出天价。时序入冬，又到了日本螃蟹的产季。人们品尝美味的蟹肉，而蟹壳的部分往往被视为厨余丢弃。但日前京都大学生态研究所教授矢野浩之，发表了一项创新的研究，将蟹
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提高FPGA设计效能的方法
随着FPGA密度的增加，系统设计人员能够开发规模更大、更复杂的设计，从而将密度优势发挥到最大。这些大规模设计基于这样的设计需求——需要在无线通道卡或者线路卡等现有应用中加入新功能，或者通过把两种
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提高FPGA设计效能的方法
提高FPGA设计效能的方法
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时钟树优化与有用时钟延迟
时钟树优化与有用时钟延迟在 “后端时序修正基本思路” 提到了时序优化的基本步骤。其中，最关键的阶段就是时钟树建立。基本的优化都优先在数据路径上进行，并且希望路径尽量的短，最好在一个时钟周期之内
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RAM读写时序限制解决方案
RAM读写时序限制解决方案
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RAM读写时序限制解决方案
RAM读写时序限制解决方案
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中国正处于地铁轨道交通快速发展期
昨天下午上海地铁发生追尾事故后，深圳地铁集团运营分公司负责人接受记者采访时，确认地铁5号线与上海地铁10号同样采用卡斯柯的信号系统，但他表示暂时不知道上海地铁运行速度，因为深圳地铁规定此情况下时速必须低于
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基于FPGA的高速自适应格型滤波器的实现
摘要：针对高速高灵敏度数字信号处理时对于自适应滤波器的数值特性和实时性的要求，在一种自适应格型联合滤波器的基础上提出算法改进，采用驰豫超前流水线技术和时序重构技术，在损失较小滤波性能的情况下，在FPGA中
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NI PXI优化半导体特性描述/生产测试能力
美商国家仪器(NI)再度扩充其PXI平台功能，以新款PPMU(Per-pin Parametric Measurement Unit)与电源量测单位(SMU)模组，用于半导体特性描述与生产测试。其中，NI PXIe-6556-200MHz高速数位输入/输出(I/O)具备PPMU；PX
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基于FPGA的高速自适应格型滤波器的实现
摘要：针对高速高灵敏度数字信号处理时对于自适应滤波器的数值特性和实时性的要求，在一种自适应格型联合滤波器的基础上提出算法改进，采用驰豫超前流水线技术和时序重构技术，在损失较小滤波性能的情况下，在FPGA中
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基于矢量网络分析仪E5071C的TDR与传统采样示波器TDR之间的测量性
最近几年随着多Gbps传输的普及，数字通信标准的比特率也在迅速提升。例如， USB 3.0的比特率达到 5 Gbps。比特率的提高使得在传统数字系统中不曾见过的问题显现了出来。诸如反射和损耗的问题会造成数字信号失真，导致
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可用为援而不可图 AMD进军内存市场无意义
由于日前在一些市场上出现了印有AMD标志的内存产品。所以有人开始认为AMD方面会借助其3A平台切入存储市场。不过近日，AMD官方正式做出回应，表示只是在进行可能性评估，不会直接制造、销售内存。而AMD官方网站上的Ra
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多路闪光器电路的时序状态和电路设计
电路原理：电路中由IC1555于47UF电容器三路输出，CD4022工作原理是：在EN脚接地，CL脚输入方波脉冲，R脚为零电平情况下，设芯片的初始输出为Q7Q6Q5Q4Q3Q2Q1Q0=0 0 0 0 0 0 0 1，则输出将随方波脉冲做表6-1所示的变化
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专访芯科实验室时序产品总经理 挟MEMS致力提升时脉性价比
个人电脑(PC)中央处理器(CPU)整合时脉势不可当，导致传统独立时脉晶片商面临收益威胁，且时序市场竞争激烈，无单一厂商可通吃市场，芯科实验室(Silicon Labs)正积极透过创新的微机电系统(MEMS)技术突显产品差异化，并
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