Arasan全新版本MIPI DSI IP满足FPGA计时限制
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Arasan发布了一款全新版本的MIPI DSI IP,其符合DSI-2 v1.0规范,支持FPGA设计在8Gbps(用于1通道)运行时高达54.72Gbps的C-PHY v2.0速度。该IP设计用于满足FPGA计时限制,以在不到200Mhz的较低频率下运行,同时仍然提供必要的带宽。(全球TMT)
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