想要一款合适的RF采样接收器?或许，它能够满足你的“欲望”

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AD6688 是一款 1.2 GHz 带宽、混合信号、直接射频 (RF) 采样接收器。它包括两个 14 位 3.0 GSPS 模数转换器 (ADC) 以及众多由四个宽带数字下变频器 (DDC) 组成的数字信号处理模块。AD6688 具有片内缓冲器和采样保持电路，确保实现较低的功耗、较小的封装尺寸和出色的易用性。该产品经过专门设计，支持那些可对高达 5 GHz 带宽的模拟信号进行直接采样的通信应用场合。ADC 输入的 3 dB 带宽大于 9 GHz。AD6688 经过了全面优化，采用小巧紧凑的封装，可以提供宽泛的输入带宽、快速的采样速率、卓越的线性度以及较低的功耗。

AD6688具有两个模拟输入通道和多达八个JESD204B输出通道对。 ADC采样高达5 GHz的宽带模拟信号。 模拟输入的实际3 dB滚降大于9 GHz。 AD6688经过优化，以小尺寸封装提供宽输入带宽，高采样率，出色的线性度和低功耗。

双ADC内核具有多级，差分流水线架构，并带有集成的输出纠错逻辑。每个ADC具有宽带宽输入，支持各种用户可选的输入范围。 集成的基准电压源简化了设计考虑。

AD6688具有多种功能，可简化通信接收机中的AGC功能。 可编程阈值检测器允许使用ADC的快速检测输出位来监视输入信号功率。 如果输入信号电平超过可编程阈值，则快速检测指示器变高。 由于该阈值指示器具有低延迟，因此用户可以快速降低系统增益，以避免ADC输入出现超量程情况。

基于JESD204B子类1的高速串行输出数据通道可以配置为一个通道(L = 1)，两个通道(L = 2)，四个通道(L = 4)和八个通道(L = 8)配置， 取决于采样率和抽取率。 通过SYSREF±和SYNCINB±输入引脚支持多设备同步。 AD6688中的SYSREF±引脚也可以用作数据的时间戳，因为它经过ADC并流出JESD204B接口。

在ADC架构上，AD6688的架构包括一个输入缓冲流水线ADC。 输入缓冲器为模拟输入信号提供终端阻抗。此终端阻抗设置为200。 输入缓冲器经过优化，可在宽带宽范围内实现高线性度，低噪声和低功耗。输入缓冲器提供线性高输入阻抗(为了简化驱动)，并减少了ADC的反冲。来自每个级的量化输出在数字校正逻辑中组合成最终的14位结果。流水线架构允许第一阶段使用新的输入样本进行操作。 同时，其余阶段将与前面的样本一起使用。采样发生在时钟的上升沿。

在模拟输入方面，AD6688的模拟输入是差分缓冲器。 缓冲器的内部共模电压为1.35V。时钟信号在采样模式和保持模式之间交替切换输入电路。可以在输入上放置一个差分电容器或两个单端电容器(或两者的组合)以提供匹配的无源网络。这些电容器最终会创建一个低通滤波器，以限制有害的宽带噪声。通常，精确的前端网络组件值取决于应用程序。

为了获得最佳动态性能，驱动VIN + x和VIN-x的源阻抗必须匹配，以使共模建立误差对称。 通过ADC的共模抑制，可以减少这些误差。 内部基准电压缓冲器创建差分基准电压，该差分基准电压定义ADC内核的跨度。

通过将ADC设置为差分配置中的最大跨度，可以实现最大的SNR性能。 对于AD6688，可用范围可通过SPI端口从1.1 V p-p至2.04 V p-p差分进行编程，默认值为1.7 V p-p差分。

对于差分输入配置，对于以SNR和SFDR为关键参数的应用，建议使用差分变压器耦合，因为大多数放大器的噪声性能不足以实现AD6688的真实性能。

对于中低频率，建议使用双巴伦或双变压器网络以实现AD6688的最佳性能。 对于第二或第三奈奎斯特区域中较高的频率，建议移除一些前端无源组件以确保宽带工作。

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