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基于FPGA的RS(255，239)编译码器设计及实现方法
RS(Reed—Solomon)编码是一种具有较强纠错能力的多进制BCH编码，其既可纠正随机错误，又可纠正突发错误。RS编译码器广泛应用于通信和存储系统，为解决高速存储器中数据可靠性的问题，文中提出了RS编码的实现方
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基于FPGA的RS(255，239)编译码器
摘要 RS(Reed—Solomon)编码是一种具有较强纠错能力的多进制BCH编码，其既可纠正随机错误，又可纠正突发错误。RS编译码器广泛应用于通信和存储系统，为解决高速存储器中数据可靠性的问题，文中提出了RS编码的实
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基于DSP的通用语音编译码器设计与实现
摘要：实现了一种基于DSP的通用语音编译码器实验平台。在该平台上通过软件重构可以实现常用语音信号的编译码。详细介绍了应用DSP实现通用语音编译码中的关键技术，包括硬件平台设计、软件结构和接口扩展等。由于硬件
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基于DSP的通用语音编译码器设计与实现
基于DSP的通用语音编译码器设计与实现
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基于FPGA的卷积码编译码器
摘要：基于卷积码的编译码原理，使用VHDL语言和FPGA芯片设计并实现了(2，1，3)卷积码编译码器。其中译码器设计采用“截尾”的Vite-rbi译码算法，在支路量度计算、路径量度和译码路径的更新与存储以及判决与
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基于FPGA的卷积编译码器的设计与实现
摘要：为了解决传统的维特比译码器结构复杂、译码速度慢、消耗资源大的问题，提出一种新型的适用于FPGA特点，路径存储与译码输出并行工作，同步存储路径矢量和状态矢量的译码器设计方案。该设计方案通过在ISE9.2i中仿
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基于VHDL的线性分组码编译码器设计
数字信号在传输过程中受到干扰的影响，降低了其传输的可靠性，线性分组码作为一种常用的信道编码，在通信传输系统中应用广泛。在对线性分组码的编译码规则研究基础上，讨论了生成矩阵、监督矩阵与错误图样集之间的关系，在Max+PlusⅡ开发环境中，用VHDL语言设计线性分组码编译码器，对其各项设计功能进行了仿真和验证。结果表明，该设计正确，其功能符合线性分组码编译码器的要求。
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基于ACE约束的S-IRA编译码器设计
摘要：考虑到结构化非规则重复累积码具有准循环的结构便于硬件实现，采用了结构化非规则重复累积码进行编码器设计。准循环矩阵的构造采用了基于ACE约束的PEG填充构造方法。结合所用码型的特点，设计出了简单有效的编
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延长电池使用时间的诀窍：运用具备讯号处理功能的超低功耗音讯编译码器
便携式消费性电子装置的制造商面临许多挑战。他们必须开发出符合成本效益又兼顾高效能与多功能音讯解决方案，同时延长电池的使用时间。另一方面，制造商还得缩短开发时间，以便抢先在市场上推出新产品。随着超低功耗
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延长电池使用时间的诀窍：运用具备讯号处理功能的超低功耗音讯编译码器
随着超低功耗编译码器具备嵌入式迷你 DSP 及强大图形式程序设计工具的发展，制造商逐渐能够达到便携式装置制造的复杂需求。
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延长电池使用时间的诀窍：运用具备讯号处理功能的超低功耗音讯编译码器
便携式消费性电子装置的制造商面临许多挑战。他们必须开发出符合成本效益又兼顾高效能与多功能音讯解决方案，同时延长电池的使用时间。另一方面，制造商还得缩短开发时间，以便抢先在市场上推出新产品。随着超低功耗
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基于BIST的编译码器IP核测试
1 引言 随着半导体工艺的发展，片上系统SOC已成为当今一种主流技术。基于IP复用的SOC设计是通过用户自定义逻辑(UDL)和连线将IP核整合为一个系统，提高了设计效率，加快了设计过程，缩短了产品上市时间。但是随着设
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