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LDPC 码译码算法及性能分析应用设计
目的是为了进一步降低低密度奇偶校验（LDPC）码译码算法的复杂度，基于经典置信传播（BP）译码算法，给出了对数域迭代后验概率对数似然比（APP LLR）算法。通过概率域的和积算法（SPA）和对数域的迭代APP LLR算法的性能仿真及分析可见，迭代APP LLR算法能以较小的性能损失换取复杂度的大幅降低。进一步选用迭代APP LLR算法，结合不同地形条件下的VHF频段信道模型，仿真了LDPC码编译码系统的性能。
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基于ACELP语音编译码算法的软件实现及应用
摘要：文中针对Tetra通信系统中采用的ACELP算法，分析了该算法的基本原理，介绍了其算法基于VC++6.0的软件实现过程，重点阐述了ACELP在网络通信中的实现及应用情况。随着通信技术的快速发展，语音编码技术发展越来越
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基于单片机的DTMF信号的译码算法研究
1、引言双音多频（DTMF）是由贝尔实验室开发的信令方式，通过承载语音的模拟电话线传送电话拨号信息。每个数字利用两个不同频率突发模式的正弦波编码，选择双音方式是由于它能够可靠地将拨号信息从语音中区分出来。一
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Turbo码特点及应用分析
Turbo 码。它巧妙地将两个简单分量码通过伪随机交织器并行级联来构造具有伪随机特性的长码，并通过在两个软入/软出(SISO)译码器之间进行多次迭代实现了伪随机译码。他的性能远远超过了其他的编码方式，得到了广泛的关
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G．723．1编译码算法的DSP实现
【摘 要】 介绍了ITU－TG．723．1标准语音编译码器的算法及其在ADSP－2181芯片上的实现 。软硬件结合实现了语音信号的采样和实时编译码，完全符合ITU－TG．723．1标准的定点算法，通过了ITU－T的所有测试向量。
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G．723．1编译码算法的DSP实现
G．723．1编译码算法的DSP实现
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Turbo简化译码算法的FPGA设计与实现
Turbo码虽然具有优异的译码性能，但是由于其译码复杂度高，译码延时大等问题，严重制约了Turbo码在高速通信系统中的应用。因此，如何设计一个简单有效的译码器是目前Turbo码实用化研究的重点。本文主要介绍了短帧Turbo译码器的FPGA实现，并对相关参数和译码结构进行了描述。
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一种高效咬尾卷积码译码器的设计与仿真
摘要：介绍了咬尾卷积码的最优和次最优译码算法的实现细节。给出了采用新的蝶形图计算方法和环形内存来节省硬件资源的实现方法，最后给出了次最优算法在FPGA上的实现结果。 关键词：咬尾卷积码；次最优译码算法；蝶
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基于BM算法的BCH码的译码硬件实现
摘要：BCH码是一种理论上比较成熟的代数码型，在电力通信系统，GSM标准的语音和数据业务，以及卫星通信和数字广播通信(DVB-S2)等多个领域均有着广泛的应用。基于幂次运算，在线性反馈移位寄存器(LFSR)下实现了基于Be
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基于DSP的信道译码算法优化
以在数字通信系统中应用广泛的Viterbi算法为例，简述Viterbi算法的基本原理和目标处理器（TMS320C6211）的处理能力；介绍C6000软件编程及优化的步骤，并提出一些具体的优化策略和技巧。
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基于DSP的信道译码算法优化
以在数字通信系统中应用广泛的Viterbi算法为例，简述Viterbi算法的基本原理和目标处理器（TMS320C6211）的处理能力；介绍C6000软件编程及优化的步骤，并提出一些具体的优化策略和技巧。
