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减少高速ADC系统中的数字反馈
消除模数转换链路中的数字反馈可能是一个挑战。在把数字输出与模拟信号链路及编码时钟隔离开来的板级设计过程中，即使在极为谨慎的情况下，模数转换器 (ADC) 输出频谱中也
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3GSps超高速ADC系统设计解决方案
包含千兆采样率ADC的系统设计会遇到许多复杂情况。面临的主要挑战包括时钟驱动、模拟输入级和高速数字接口。本文探讨了如何才能克服这些挑战，并给出了在千兆赫兹的速度下进
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16位、100 kSPS逐次逼近型ADC系统
连接/参考器件 AD7988-1 16位、100 kSPS PulSAR ADC AD8641低功耗、轨到轨输出精密单通道JFET运算放大器 ADR435超低噪声XFET 5.0 V基准电压源，具有吸电流和源电流
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16位、300 kSPS低功耗逐次逼近型ADC系统解析
连接/参考器件AD7988-5 16位、500 kSPS PulSAR ADCOP1177精密、低噪声、低输入偏置电流运算放大器ADR435超低噪声XFET® 5.0 V基准电压源，具有吸电流和源电流能力评估和设计支持电路评估板CN-0305电路评估板(EVAL
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多ADC系统的基准电压设计
多模/数转换器(ADC)系统所能达到的精度直接取决于ADC的基准电压。举例来讲，医疗超声成像系统通常会在其接收器的波束成形电路中包含大量的ADC，常常以16、24、32等为一组。要得到最高的波束精度，需要最大限度地减小
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减少高速ADC系统中的数字反馈
本文解释了数字反馈，并讨论了一种新的创新性 ADC，这种 ADC 内置了一些功能，在良好设计的布局也许不足以解决问题的情况下，这些功能可用来克服数字反馈。
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基于DSP和CPLD技术的多路ADC系统的设计
介绍了基于DSP和CPLD技术，高精度多通道的ADC系统的设计与实现方案，利用简单的硬件电路和软件编程，采用DSP和CPLD相结合的方法，动态地设置采样通道，控制模数转换器MAX1162的数据采样及传输。
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基于DSP和CPLD技术的多路ADC系统的设计
介绍了基于DSP和CPLD技术，高精度多通道的ADC系统的设计与实现方案，利用简单的硬件电路和软件编程，采用DSP和CPLD相结合的方法，动态地设置采样通道，控制模数转换器MAX1162的数据采样及传输。
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基于DSP和CPLD技术的多路ADC系统的设计
介绍了基于DSP和CPLD技术，高精度多通道的ADC系统的设计与实现方案，利用简单的硬件电路和软件编程，采用DSP和CPLD相结合的方法，动态地设置采样通道，控制模数转换器MAX1162的数据采样及传输。
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基于AD9444的时间交叉采样ADC系统
应用AD9444的并采用AFB技术的四通道时间交叉采样ADC系统在提高分辨率的同时，也提高了系统的采样速率。
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基于AD9444的时间交叉采样ADC系统
应用AD9444的并采用AFB技术的四通道时间交叉采样ADC系统在提高分辨率的同时，也提高了系统的采样速率。
