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基于CPLD的并口数据的采集和存储
摘 要：提出了一种利用CPLD实现雷达并口数据的采集和存储的方案。采用单片CPLD完成了以往需要大量外围器件来完成的雷达并口数据收发及存储功能，有效地减少了印制板上功能模块的面积，减少了系统体积，提高了设计效率
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利用FPGA的新功能保证视频设计安全性
越来越多的消费应用开始在设计中集成流式视频，结果引入了许多标准和专有的加密算法。但是加密方案以及实现方法不统一导致视频接收设备在设计和支持方面存在巨大的挑战。DeviceDNA作为FPGA的一项新功能，可保证
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PWM控制电路基本原理与FPGA
在直流伺服控制系统中,通过专用集成芯片或中小规模的数字集成电路构成的传统PWM控制电路往往存在电路设计复杂,体积大,抗干扰能力差以及设计困难、设计周期长等缺点?因此PWM控制电路的模块化、集成化已成为发展趋势.
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FPGA的进步铺平了通向真正的SoC解决方案之路
全定制数字ASIC的前景开始出现阴影。现场可编程门阵列(FPGA)正在接管许多一度被认为是全定制芯片专属领域的应用。自从FPGA在约二十年前出现以来，它已经通过将门数提高了三个数量级而侵占了ASIC的主导地位。此外
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基于DDS技术的多路同步信号源的设计
摘 要：多路同步数字调相信号源一般采用单片机和多片专用DDS芯片配合实现。该技术同步实现复杂，成本高。给出了一种基于FPGA的多路同步信号源的设计方法，通过VHDL语言硬件编程实现了基于单片FPGA的多路同步信号，数
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allegro使二条时钟线等长的方法
为了使二个SDRAM的时钟线等长，我查阅了很多资料，设置等长的方法有很多，在这里我们只为了二条时钟线等长来学习如何通过设置约束规则然后通过延时处理达到等长的目的。 首先是我们先要为想要等长的线找一个精
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基于SOPC的低电压电泳芯片系统平台设计
1 引 言 生物芯片的控制、检测与分析是生物芯片技术中的重要组成部分，最早的应用起源于毛细管电泳芯片的检测，其目的是实现基因片段的分离。从电泳芯片的研究现状可以看出，目前研究主要是将毛细管电泳技
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高速环境下的状态机设计和优化方法
通过减少寄存器间的逻辑延时来提高工作频率，或通过流水线设计来优化数据处理时的数据通路来满足高速环境下FPGA或CPLD中的状态机设计要求。本文给出了采用这些技术的高速环境状态机设计的规范及分析方法和优化方
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仿真扩展芯片简化高速汽车嵌入式处理器的集成
1 引言 由于缺乏适当的数学手段以及自适应系统本身严重的非线性，对具有时变参数的线性系统进行控制分析是非常困难的。应该指出，时变系统自适应控制的关键在于，如何提高系统对由参数时变引起的摄动的鲁棒性
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基于LabVIEW的多核系统编程技术
因为NI LabVIEW是数据流编程语言，开发者们可以编写并行的应用程序，这些应用程序可以直接映射到并行的硬件(如多核心处理器和FPGA等)上以获得最优异的性能。这篇白皮书讨论了什么是数据流编程以及为什么说NI Lab
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如何将RF与数模电路设计在同一PCB上？
手持无线通信设备和遥控设备的普及推动着对模拟、数字和RF混合设计需求的显著增长。手持设备、基站、遥控装置、蓝牙设备、计算机无线通信功能、众多消费电器以及军事/航空航天系统现需要采用RF技术。数年来，RF设计需
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成功解决FPGA设计时序问题的三大要点
FPGA的设计与高速接口技术可以帮助你满足今天的市场要求，但也提出了一些有趣的设计挑战。为了确保存储器接口的数据传输准确，在超过200兆赫兹以上，进行时序分析将发挥更突出的作用，以识别和解决系统运行的问题。在
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CPLD的DSP多SPI端口通信设计
摘 要 多SPI端口通信是一种小型的高速同步通信网络。这种网络结构简单、成本较低，广泛应用于控制器与控制器、控制器与外围芯片之间的通信；但由于时序复杂，高频脉冲传输数据容易出错。本文在对SPI端口信号时序分析
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采用FPGA实现音频模数转换器
摘 要 简要分析sigma—deIta(∑一△)架构模数转换器(ADC)原理，提出一种基于FPGA内部LVDS(Low Voltage Differential Signaling)接收器的音频ADC架构，并给出在FPGA上的实现结果。在FPGA内部实现音频ADC，具有扩展方便
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ADSP TS201链路口通信的FPGA实现
O 引 言 随着电子技术的飞速发展，在实际应用中数据高速传输有着越来越高的要求，链路口为数据传送提供了高速、独立的通信机制，得到广泛应用。AD公司生产的TS201 DSP就具备这种端口。为了使不具备此接口的器件
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