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嵌入式实时图像处理系统中SDRAM控制器的实现
0 引 言SDRAM作为大容量、高速度、低价格、低功耗的存储器件，在嵌入式实时图像处理系统中具有很高的应用价值，但其控制机制复杂，因此需要设计控制器，以简化系统对SDRAM的访问。虽然目前许多微处理器及DSP都提供了
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基于SDR SDRAM的视频数据逻辑分析存储器的设计与实现
摘要：针对传统硬件测试软件的弊端，文章提出一种便携式视频数据逻辑分析存储器的设计方法，这种分析存储器能够针对网络多媒体数据进行采集、分析和存储等操作。在不影响网络正常传输的前提下，针对TS流进行采集、存
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嵌入式实时图像处理系统中SDRAM控制器的实现
0 引 言 SDRAM作为大容量、高速度、低价格、低功耗的存储器件，在嵌入式实时图像处理系统中具有很高的应用价值，但其控制机制复杂，因此需要设计控制器，以简化系统对
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基于AMBA-AHB总线的SDRAM控制器的计方案
为了在嵌入式系统设计中实现对SDRAM存储器的访问，本文提出了一种基于AMBA-AHB总线规范的SDRAM控制器设计方案。方案首先简要介绍了AMBA总线规范，然后在完成整个存储控制器的整体框架设计的基础上给出了SDRAM控制器的实现原理以及详细的子模块划分。整个控制器的设计已用Verilog HDL语言实现并通过了Modelsim仿真和FPGA验证。仿真结果表明所设计的控制器符合SDRAM内部指令操作，并且满足了严格的时序要求。
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基于AMBA-AHB总线的SDRAM控制器的计方案
为了在嵌入式系统设计中实现对SDRAM存储器的访问，本文提出了一种基于AMBA-AHB总线规范的SDRAM控制器设计方案。方案首先简要介绍了AMBA总线规范，然后在完成整个存储控制器的整体框架设计的基础上给出了SDRAM控制器的实现原理以及详细的子模块划分。整个控制器的设计已用Verilog HDL语言实现并通过了Modelsim仿真和FPGA验证。仿真结果表明所设计的控制器符合SDRAM内部指令操作，并且满足了严格的时序要求。
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一种基于FPGA的DDR SDRAM控制器的设计
摘要 对DDR SDRAM的基本工作特性以及时序进行了分析与研究，基于FPGA提出了一种通用的DDRSDRAM控制器设计方案。在Modelaim上通过了软件功能仿真，并在FPGA芯片上完成了硬件验证。结果表明，该控制器能够较好地完成DD
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用Xilinx FPGA实现DDR SDRAM控制器
1 引言在高速信号处理系统中, 需要缓存高速、大量的数据, 存储器的选择与应用已成为系统实现的关键所在。DDR SDRAM是一种高速CMOS、动态随机访问存储器, 它采用双倍数据速率结构来完成高速操作。SDR SDRAM一个时钟周
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基于FPGA 的DDR SDRAM控制器在高速数据采集系统中应用
实现数据的高速大容量存储是数据采集系统中的一项关键技术。本设计采用Altera 公司Cyclone系列的FPGA 完成了对DDR SDRAM 的控制，以状态机来描述对DDR SDRAM 的各种时序操作，设计了DDR SDRAM 的数据与命令接口。用控
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基于VHDL的SDRAM控制器的实现
在高速实时或者非实时信号处理系统当中，使用大容量存储器实现数据缓存是一个必不可少的环节，也是系统实现中的重点和难点之一。SDRAM（同步动态随机访问存储器）具有价格低廉、密度高、数据读写速度快的优点，从而成
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基于EPM1240的SDRAM控制器的设计
摘要：SDRAM的读写逻辑复杂，最高时钟频率达100 MHz以上，普通单片机无法实现复杂的SDRAM控制操作，复杂可编程逻辑器件CPLD具有编程方便，集成度高，速度快，价格低等优点。因此选用CPLD设计SDRAM接口控制模块，简化
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一种面向H．264视频编码器的SoC验证平台
摘要：构建了面向H．264视频编码器的SoC验证平台，采用FPGA原型系统完成H．264编码器验证。采用Wishbone总线连接32位微处理器OR120 0以及其他的必要IP核构建基本SoC平台，并在此基础上集成H．264硬件编码模块；根据H
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基于EPM1240的SDRAM控制器的设计
摘要：SDRAM的读写逻辑复杂，最高时钟频率达100 MHz以上，普通单片机无法实现复杂的SDRAM控制操作，复杂可编程逻辑器件CPLD具有编程方便，集成度高，速度快，价格低等优点。因此选用CPLD设计SDRAM接口控制模块，简化
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一种面向H．264视频编码器的SoC验证平台
摘要：构建了面向H．264视频编码器的SoC验证平台，采用FPGA原型系统完成H．264编码器验证。采用Wishbone总线连接32位微处理器OR120 0以及其他的必要IP核构建基本SoC平台，并在此基础上集成H．264硬件编码模块；根据H
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PDMA在测试SDRAM控制器中的应用
PDMA在测试SDRAM控制器中的应用
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基于FPGA的外部存储器设计
摘要：为了提高雷达海量数据的处理速度，采用FPGA设计了一种高速外部存储器，通过多次实验，验证了设计方法的可行性。高速外部存储器可以有效地提高数据存储速度，节约读／写时间，从而满足信号处理的高速实时的要求
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PDMA在测试SDRAM控制器中的应用
我们设计了一个PDMA（Programmable Direct Mem o ry Access）用于测试SDRAM控制器的性能。在SoC中，SDRAM控制器往往跟多个IP模块（图形处理单元，音频处理单元等）交换数据，采用多个PDMA通道同时访问Memory可以真实
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基于Stratix III的DDR3 SDRAM控制器设计
1 引言 DDR3 SDRAM是由JEDEC（电子设备工程联合委员会）制定的全新下一代内存技术标准，具有 速度更快、功耗更低、效能更高以及信号质量更好等优点，对于解决高速系统(例如某些高速图 像处理系统)设计中由于存储
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实时视频采集系统的SDRAM控制器设计
描述了一种在PAL→VGA的实时视频采集系统中图像数据处理的方法。针对实时视频采集系统一般使用2片SDRAM进行乒乓缓存的方式，给出一种使用一片SDRAM的不同BANK进行乒乓操作的相对容易实现的SDRAM控制器设计方法。该方法通过充分利用SDRAM的切换BANK存取操作并采用指令计数的方式进行读写状态转换，在PAL→VGA实时视频采集系统中实现了利用一片SDRAM进行图像缓存。它在实时视频采集系统中图像数据处理方面，具有良好的应用价值。
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多端口SDRAM控制器的设计与实现
0 引 言 目前，在很多视频数据采集以及实时显示的应用开发中，常需要用到存储容量大、读写速度快的存储器。在各种存储器件中，同步动态随机存储器SDRAM 以其速度快、容量大、价格低的特点而备受关注。SDRAM 的工
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