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利用串行RapidIO连接功能增强DSP协处理能力
SRIO 正出现在大量新应用中，主要以有线和无线应用中的 DSP 为中心。在 Xilinx 器件中实现 SRIO 架构的主要优势包括：整个 SRIO 端点解决方案的可用性;灵活性和可扩展性，便于使用同样的硬件和软件架构制成不同级别的产品;通过新 GTP 收发器和 65 nm 技术实现了低功耗;通过 CORE Generator 软件 GUI 工具轻松进行配置;与业界领先的供应商间的硬件协同工作能力经过了验证，支持其器件上的 SRIO 连接; 通过使用 PCIe 和 TEMAC 等集成 I/O 模块，实现了
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用RapidIO提高DSP阵列的性能
“采用SERDES(串行/解串器)技术后只需少量引脚就能获得很高的带宽。由于硬件全部承担了协议栈的处理，RapidIO减少了原来仅用于在系统中传输数据的宝贵DSP周期。”Shippen说，“例如，多个飞思卡尔公司的StarCorebase
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迎合3.5G/4G基站Serial RapidIO架构趋势的解决方案
随着用户对于行动数据需求的增加，电信服务业者必须快速地布建 3.5G 和 4G 基站。这也使得下一代基站的架构需要高频宽的背板，以容纳多重的基频卡(baseband card)数据传输的需求，而基频板则需要数组的多核心数字信
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全球首屈一指的RapidIO IP解决方案
RapidIO最早是由美国Mercury Computer systems公司（美国水星计算机系统公司www.mc.com）为它的计算密集型信号处理系统自行开发的总线技术。RapidIO是一种分组交换结构，最初开发它的目的是用来连接线路板上的
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LATTICE携手PRAESUM推出SERIAL RapidIO解决方案
Lattice Semiconductor近日宣布，网络通信应用的交换和桥接解决方案供应商Praesum优化了其用于LatticeECP2M系列的Serial RapidIO接口端点方案，LatticeECP2M系列是集成有SERDES I/O的低成本90nm FPGA。 此外
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串行 RapidIO: 高性能嵌入式互连技术
摘要 串行RapidIO针对高性能嵌入式系统芯片间和板间互连而设计，它将是未来十几年中嵌入式系统互连的最佳选择。 本文比较RapidIO和传统互连技术的优点；介绍RapidIO协议架构，包格式，互连拓扑结构以及串行Rap
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基于FPGA实现DSP与RapidIO网络互联
本文首先简单的介绍了总线的发展，从而引出一种新型的串行点对点交换结构RapidIO。DSP 在高性能处理系统中的重要性毋庸置疑，但是目前的很多DSP 并没有RapidIO接口。本文提出了利用FPGA，将DSP 的总线桥接到一个RapidIO IP 上，从而实现了DSP与RapidIO 网络的互联。
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用RapidIO提高DSP阵列的性能
“采用SERDES(串行/解串器)技术后只需少量引脚就能获得很高的带宽。由于硬件全部承担了协议栈的处理，RapidIO减少了原来仅用于在系统中传输数据的宝贵DSP周期。”Shippen说，“例如，多个飞思卡尔公司的StarCorebase
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迎合3.5G/4G基站Serial RapidIO架构趋势的解决方案
随着用户对于行动数据需求的增加，电信服务业者必须快速地布建 3.5G 和 4G 基站。这也使得下一代基站的架构需要高频宽的背板，以容纳多重的基频卡(baseband card)数据传输的需求，而基频板则需要数组的多核心数字信
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全球首屈一指的RapidIO IP解决方案
RapidIO最早是由美国Mercury Computer systems公司（美国水星计算机系统公司www.mc.com）为它的计算密集型信号处理系统自行开发的总线技术。RapidIO是一种分组交换结构，最初开发它的目的是用来连接线路板上的
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利用串行RapidIO实现FPGA协处理
为了支持“三重播放”应用，人们对高速通信和超快速计算的需求日益增大，这向系统开发师、算法开发师和硬件工程师等人员提出了新的挑战，要求他们将各种标准、组件和联网设备融合成一个整体
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串行 RapidIO: 高性能嵌入式互连技术
摘要 串行RapidIO针对高性能嵌入式系统芯片间和板间互连而设计，它将是未来十几年中嵌入式系统互连的最佳选择。 本文比较RapidIO和传统互连技术的优点；介绍RapidIO协议架构，包格式，互连拓扑结构以及串行Rap
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基于FPGA实现DSP与RapidIO网络互联
本文首先简单的介绍了总线的发展，从而引出一种新型的串行点对点交换结构RapidIO。DSP 在高性能处理系统中的重要性毋庸置疑，但是目前的很多DSP 并没有RapidIO接口。本文提出了利用FPGA，将DSP 的总线桥接到一个RapidIO IP 上，从而实现了DSP与RapidIO 网络的互联。
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利用串行RapidIO实现FPGA协处理
为了支持“三重播放”应用，人们对高速通信和超快速计算的需求日益增大，这向系统开发师、算法开发师和硬件工程师等人员提出了新的挑战，要求他们将各种标准、组件和联网设备融合成一个整体
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首款串行 RapidIO 2.1 IP 解决方案(Altera)
Altera 公司 宣布推出业界首款支持 RapidIO® 2.1 规范的知识产权 (IP) 内核。Altera 的串行 RapidIO IP 内核可支持多达四条通道，每条通道速率为 5.0 GBaud，从而满足了无线市场日益增长的带宽和可靠性需求。该
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首款串行 RapidIO 2.1 IP 解决方案(Altera)
Altera 公司 宣布推出业界首款支持 RapidIO® 2.1 规范的知识产权 (IP) 内核。Altera 的串行 RapidIO IP 内核可支持多达四条通道，每条通道速率为 5.0 GBaud，从而满足了无线市场日益增长的带宽和可靠性需求。该
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IDT的RapidIO Gen2产品将提升无线、视频等应用的整体性能
关键字: RapidIO MCU STM8L 在无线、视频和嵌入式系统(如军事)等领域，具有广泛兼容性的RapidIO互连架构提供了高性能的分组交换技术，能充分满足芯片间与主板间通信(速率超过10Gbps)对可靠性与高带宽的要求。但随着
