本文对按键的抖动信号进行了分析,并通过计数器的方式完成了消除抖动电路模块的设计。
本文针对 CPLD的核心可编程结构:P-Term和可编程互连线,采用2.5V、0.25μmCMOS工艺设计了功能相近的基于SRAM编程技术的可重构电路结构。
介绍FPGA的配置方式、配置数据文件和详细配置过程,以及单片机配置FPGA的优点,创新地提出配置数据存放在U盘中的思想;同时也介绍了单片机控制读/写USB设备(如U盘)的软硬件设计
数字调制解调技术在数字通信中占有非常重要的地位,数字通信技术与FPGA的结合是现代通信系统发展的一个必然趋势。文中介绍了MFSK调制解调的原理,并基于FPGA实现了MFSK调制电路,仿真结果表明了该设计的正确性。
本文主要分析了FIR数字滤波器的基本结构和硬件构成特点,简要介绍了FIR滤波器实现的方式优缺点;结合Altera公司的Stratix系列产品的特点,以一个基于MAC的8阶FIR数字滤波器的设计为例,
本文介绍了Synopsys的RVM验证方法学,采用Vera硬件验证工具以及OpenVera验证语言建立目标模型环境,自动生成激励,完成自核对测试、覆盖率分析等工作。
针对高速图像目标实时识别和跟踪任务,需要利用系统中有限的硬件资源实现高速、准确的二值图像连通域标记,提出了一种适合FPGA实现的二值图像连通域标记快速算法。
针对兰州重离子加速器冷却储存环(HIRFL-CSR)踢轨磁铁(Kicker)电源的需要,设计了一种基于可编程逻辑器件(CPLD)的高速可程控数字延迟线系统。
利用Verilog HDL 硬件描述语言自顶向下的设计方法和QuartusⅡ 软件,在复杂的可编程逻辑器件(FPGA, Field Programmable Gate Array)中实现了发电机组频率测量计的设
随着电子技术的迅速发展,高速信号触发源已经广泛应用于通讯、雷达等各种电子系统的测试和精确控制中
本文采用先进的EDA(电子设计自动化)技术,利用QuartusⅡ工作平台和VHDL(超高速集成电路硬件描述语言),设计了一种新型的电子密码锁。
本文就是在基于NiosII的SOPC中设计了一个EEPROM Controller Core,用Verilog HDL描述硬件逻辑部分,同时编写相关驱动,下载到Stratix系列的 FPGA中实现了对片外EEPROM AT24C02的读写。
本论文主要讨论和仿真了基于CPLD的PSK系统单元设计,在阐述调制解调系统的基本原理与设计方法的同时,又详细地介绍了系统的总体电路框图及各个模块的具体软硬件实现。
本文利用FPGA实现了基于RU算法的编码器设计实现。在Quartus II软件环境下对LDPC编码器进行仿真,使用Stratix系列EP1s25F672I7芯片,对码长为504的码字进行编码。
本文设计的便携式边界扫描故障诊断仪不同于传统的边界扫描设备,不依靠PC就可实现边界扫描测试与诊断,特别适合特殊领域的现场在线使用。