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PIC WWVB时钟设计
有很多DIY WWVB在网络上的时钟设计的版本。商业的“原子”的钟表价格便宜和广泛使用，但我想试试我的手，在设计一个获得接收到WWVB的洞察和了解一点点编程PIC单片机。我的版本是不是最简单的，但它工作得很
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晶振的几种接法
晶振的时钟基准作用我这里就不用多说了，没有去查书，凭记忆依稀记得以下两种常用的接法。 1.这种接法的优点就是起振容易，适应频率范围比较宽。具体频率范围本
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一种异步FIFO的设计方法
摘要：使用FIFO同步源自不同时钟域的数据是在数字IC设计中经常使用的方法，设计功能正确的FUFO会遇到很多问题，探讨了两种不同的异步FIFO的设计思路。两种思路都能够实现功能正确的PIFO。本文所研究的FIFO，从硬件的
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理解高性能Σ-Δ ADC中时钟公差对50Hz/60Hz噪声抑
摘要：本文探讨了时钟公差对Σ-Δ ADC中低通抽样和数字滤波器的影响，特别是对滤波器陷波频率的影响。窄带Σ-Δ应用通常利用数字滤波器提供50Hz、60Hz或50Hz/60Hz的噪声抑制。在选择外部时钟晶体
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基于CPCI总线的PowerPC主处理板设计
基于CPCI总线的PowerPC主处理板设计
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FPGA时钟设计
摘要：在FPGA设计中，为了成功地操作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压下将导致错误的行为。在设计PLD／FPGA时通常采用如下四种类型时钟：全局时钟、门控时钟、多级逻辑时钟和波动式时钟。
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理解高性能ADC中时钟公差对50Hz/60Hz噪声抑制的影响
摘要：RF衰减是无线设计中的常见电路，本应用笔记详细描述了几种采用PIN二极管和电流源DAC控制RF衰减的方法。 PIN二极管通常作为TV调谐器中的RF信号以及固定通信设备中宽带RF的可变衰减器。这类二极管可以作为分立
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超低抖动时钟合成器的设计挑战
该应用笔记提出了超低抖动时钟合成器的一种设计思路，其目标是产生2GHz时钟时，边沿之间的抖动< 100fs。分析和仿真结果表明，要达到这一抖动指标，设计难度远远高于预期。关于元器件变量和折衷方案的讨论为进一步的研
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单片机编程中的时钟中断
本文以6MHz时钟的单片机AT89C51系统为例，说明时钟中断的应用： 定时器初值与中断周期 时钟中断无需过于频繁，一般取20mS(50Hz)即可。如需要百分之一秒的时基信号，可取10mS(100Hz)。这里取20mS，用定时器T0工作
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PCB评估过程中注意因素
要获得一个能处理布局的PCB工具是容易的;但获得一个不仅能满足布局而且能解决你的燃眉之急的工具才是至关重要的。 作为研发人员，考虑的是如何将最新的先进技术集成到产品中。这些先进技术既可以体现在卓越的产品
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主板的走线和布局设计详解
对于一块主板而言，除了应在零部件用料(如采用优质电容、三相电源线路等)方面下功夫外，主板的走线和布局设计也是非常重要的。由于主板走线和布局设计的形式很多，技术性非常强，因此这也是优质主板与劣质主板的一
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USB3.0认证的新测试要求和应对方案详解
随着主流市场即将演进到SuperSpeed USB，许多设计团队正力图加快设计认证。本文将为您提供专家建议参考，帮助您轻松完成这一过程。 尽管市场上已经出现了早期的USB 3.0产品，但主流市场转向Super
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USB3.0认证的新测试要求和应对方案详解
随着主流市场即将演进到SuperSpeed USB，许多设计团队正力图加快设计认证。本文将为您提供专家建议参考，帮助您轻松完成这一过程。 尽管市场上已经出现了早期的USB 3.0产品，但主流市场转向Super
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海思采用华大九天SoC时钟时序工具
作为中国本土最大的电子设计自动化(EDA)软件工具厂商，华大九天 (HES)近日宣布，通信网络和数字媒体集成电路设计公司海思半导体有限公司（HiSilicon Technologies）已选中华大九天的ClockExplorer 和 TimingExplorer
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LED显示屏发送卡设计
该发送卡由DVI模块、FPGA控制器、两路千兆网输出模块构成。DVl解码芯片将解码得到的数据和控制信号传给FPGA控制器，FPGA通过内部的RAM 进行缓存，并做了更换时钟域和位宽变换的操作，然后将处理后的数据通过千兆网输出。
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LED显示屏发送卡设计
该发送卡由DVI模块、FPGA控制器、两路千兆网输出模块构成。DVl解码芯片将解码得到的数据和控制信号传给FPGA控制器，FPGA通过内部的RAM 进行缓存，并做了更换时钟域和位宽变换的操作，然后将处理后的数据通过千兆网输出。
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试用手记：为国产FPGA正名(五，外扩SFR使用)
题记：本以为这个国产FPGA的就此夭折，没想到权衡之后，在性能打些折扣的情况下还是重新捡起来了。从刚接触这个器件的时候特权同学就很关心它的硬核可扩展性，Avalone接口用上手了，当然很希望这个51硬核也能够提供
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单片机编程技巧－时钟中断
功能强大的时钟中断 在单片机程序设计中，设置一个好的时钟中断，将能使一个CPU发挥两个CPU的功效，大大方便和简化程序的编制，提高系统的效率与可操作性。我们可以把一些例行的及需要定时执行的程序放在时钟中
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高速转换器时钟分配器件的端接
高速转换器时钟分配器件的端接
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PIC16C64单片机外部功能特点
PIC16C64单片机外部功能特点
cm1z
EverEin
jejeje
夏洛克柯南
mellonl
我有RPWT
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yuhunewton
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说到底
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唯爱珊
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