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基于FPGA的8段数码管动态显示IP核设计
设计基于FPGA的8段数码管动态显示IP核，介绍8段数码管内部结构及其驱动显示方式和IP核设计方法，给出8段数码管动态显示IP核的Verilog HDL程序源代码及其C语言驱动程序。此IP核可例化成1～8个共阴极(或共阳极)数码管控制器，能方便地控制1～8个数码管同时显示数字和小数点位。测试结果表明，该IP核工作可靠、稳定，可直接应用于电子设计中。
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基于FPGA的8段数码管动态显示IP核设计
设计基于FPGA的8段数码管动态显示IP核，介绍8段数码管内部结构及其驱动显示方式和IP核设计方法，给出8段数码管动态显示IP核的Verilog HDL程序源代码及其C语言驱动程序。此IP核可例化成1～8个共阴极(或共阳极)数码管控制器，能方便地控制1～8个数码管同时显示数字和小数点位。测试结果表明，该IP核工作可靠、稳定，可直接应用于电子设计中。
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基于FPGA的8段数码管动态显示IP核设计
基于FPGA的8段数码管动态显示IP核设计
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在FPGA上对OC8051IP核的修改与测试
引 言 20世纪80年代初，Intel公司推出了MCS-51单片机，随后Intel以专利转让的形式把8051内核发布给许多半导体厂家，从而出现了许多与MCS-51系统兼容的产品。这些产品与MCS-51的系统结构相同，采用CMOS工艺，因
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视点：IP核市场和展望
视点：IP核市场和展望
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基于FPGA的RS232异步串行口IP核设计
1 引言 数据采集系统常需要进行异步串行数据传输。目前广泛使用的RS232异步串行接口，如8250、 NS16450等专用集成器件，虽然使用简单，却占用电路板面积、布线复杂等缺点。片上系统SoC(System on Chip)是以嵌入
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安全芯片中密码算法的多IP核集成方法
信息社会中，基于密码算法设计的安全芯片，能够为用户的敏感信息提供有效的机密性与完整性保护。信息化的不断深入使得人们对信息安全服务的需求呈现使用简单化、功能多样化、高度集成化等趋势。这要求安全芯片在
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中国集成电路IP技术及市场发展现状分析
日前，工业和信息化部软件与集成电路促进中心对外发布了《2008年集成电路IP核技术和市场调查报告》，全面总结了国际与国内的IP核技术与市场的发展状况，针对我国IP核产业的发展提出了对策与建议。 国内IP市场规模
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WiChorus数据包核心设备赢得Clearwire骨干支撑网订单
9/3/2009，美国新兴公司WiChorus日前宣布赢得WiMAX运营商Clearwire的多年期数据包核心设备软硬件供货合同。Clearwire已经在多个市场部署了WiChorus的Smart 4G 数据包核心设备。为了适应从IP视频，网络电话到互联网浏
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AMBA息线SOC系统IP核的即插即用研究
引 言 SoC设计的快速发展是以IP核复用为基础的。IP核的复用极大地提高了SoC系统设计的开发效率，SoC 片上总线的选择是IP核间集成与互连的关键技术之一。目前片上总线的标准协议众多，如ARM公司提出的AMBA总线
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基于EDA软件和FPGA的IP核保护技术
随着电路复杂性的增加，越来越多的设计者开始采用拥有知识产权的、设计良好的功能模块来加快系统开发。因此，需要相应的技术手段保护这些功能模块不被非法复制、篡改或窃取。针对FPGA开发中的知识产权保护问题，提出一种结合EDA软件和FPGA的IP(Intellectual Proterty)核保护方法，有效的防止IP核被窃取，以及防止最终在FPGA上实现设计的非法复制。
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发展国内硅知识产权若干建议
发展国内硅知识产权，首先要重视高端通用IP核研发、验证与评估。SoC实现的重要途径是复用高质量的成熟IP。而IP设计和验证是高质量IP开发流程中两个不可或缺的部分。应该看到，由于国内IP供应商在产品和技术上不够成熟
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基于FPGA IP核的FFT实现
对于FFT而言，很多领域都提出了其高速实时运算的要求。利用FFT IP核实现FFT算法，并在cycloneⅡ系列的EP2C70F896C8器件上设计出处理速度为69.58 MHz的24位512点复数FFT处理器需29.3 μs，该方法具有效率高、速度快、周期短、灵活性强等特点。仿真结果表明此方法具有良好性能。
