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基于多速率DA的根升余弦滤波器的FPGA实现
0 引 言 根升余弦成形滤波器是数字信号处理中的重要部件，它能对数字信号进行成形滤波，压缩旁瓣，减少干扰的影响，从而降低误码率。根据文献[1]，它的传统FP-GA实现方式基于乘累加器(Multiplier Add Cell，M
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FIR带通滤波器的FPGA实现
为设计一个项目可用的FIR数字带通滤波器，采用Matlab／Simulink软件中DSPBulider强大的算法模块设计工具，结合Altera公司的FPGA开发板实现FIR数字带通滤波器的系统集成、RTL级仿真、综合编译、下载等设计流程，并对正弦信号进行滤波，结果下载到开发板上用示波器观测，达到了预期的滤波效果和目的。基于DSPBuilder完成系统建模，省去了复杂的VHDL编程，还可针对具体模块进行参数设置从而适应不同的滤波需求。该方法实现简单、可靠，还可类推实现其他复杂的嵌入式系统设计。
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基于多速率DA的根升余弦滤波器的FPGA实现
0 引 言 根升余弦成形滤波器是数字信号处理中的重要部件，它能对数字信号进行成形滤波，压缩旁瓣，减少干扰的影响，从而降低误码率。根据文献[1]，它的传统FP-GA实现方式基于乘累加器(Multiplier Add Cell，M
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DS/FH混合扩频接收机解扩及同步技术的FPGA实现
研究采用编码扩频的DS/FH混合扩频接收机的核心模块——同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上，实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成，提高了捕获速度。实验结果证明该方案是正确可行的。
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DS/FH混合扩频接收机解扩及同步技术的FPGA实现
研究采用编码扩频的DS/FH混合扩频接收机的核心模块——同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上，实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成，提高了捕获速度。实验结果证明该方案是正确可行的。
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H．264中二进制化编码器的FPGA实现
1 引言 随着数字电视及视频会议的发展以及应用，H．264由于其更高的压缩比、更好的图像质量和良好的网络适应性而备受关注。 基于上下文的自适应二进制算术编码(CABAC)则作为H．264编码器系统的最后一环，对
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DCT域数字水印算法的FPGA实现
1 引言 随着计算机网络和数字通信技术的迅速发展，数字技术使数字多媒体(数字视频、数字音频、数字图像等)的传输与复制变得非常容易，但却增加了多媒体信息被非法盗版的机会。数字作品的版权保护成为一个急需解
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拉普拉斯算子的FPGA实现方法
为了能快速实现Laplacian算子高频增强功能，通过理论研究设计出该算子实现的硬件结构。提出一种调用仿真软件中宏功能块快速实现算法的硬件实现模式。详细介绍使用QuattusⅡ中Megafunctions宏功能模块库实现3×3模板Laplacian算子的过程。通过实验结果表明，用该方法实现的算子能够取得良好的滤波效果，且设计方便、有效，为相似功能模块的设计提供了新思路。
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Sobel边缘检测的FPGA实现
为了采用FPGA来实时实现Sobel边缘检测，设计者往往自己编写代码。在此介绍基于QuartusⅡ提供的参数可设置宏功能模块，实现Sobel边缘检测的新方案。该方案获得了比用户编写的代码更优的综合和实现结果，节省了宝贵的设计时间，并且获得了很好的边缘检测效果。
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DCT域数字水印算法的FPGA实现
1 引言 随着计算机网络和数字通信技术的迅速发展，数字技术使数字多媒体(数字视频、数字音频、数字图像等)的传输与复制变得非常容易，但却增加了多媒体信息被非法盗版的机会。数字作品的版权保护成为一个急需解
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基于数字移相的高精度脉宽测量系统及其FPGA实现
在测量与仪器仪表领域,经常需要对数字信号的脉冲宽度进行测量.这种测量通常采用脉冲计数法,即在待测信号的高电平或低电平用一高频时钟脉冲进行计数,然后根据脉冲的个数计算待测信号宽度,如图1所示.待测信号相对于
